ELECINF102 : Processeurs et Architectures Numériques

Description

Les fiches descriptives sont disponibles sur Éole: ELECINF102

Organisation pédagogique

  • Le module est organisé en 10  séances.
  • Chaque séance de travail comporte à la fois des cours, des TD et des mises en pratique utilisant des outils informatique.
  • Chaque séance sera éventuellement précédée par un travail "à la maison" qui peut être rendu par les étudiants et être pris en compte dans la notation finale.
  • Il sera tenu compte de l'implication dans le module pour la notation finale.
  • Le contrôle de connaissance consiste en un devoir sur table de 1TH.
  •  L'ensemble des apprentissages théoriques et pratiques effectués pendant les séances sont au programme du contrôle de connaissance.

Les thèmes abordés

Le langage de description de matériel SystemVerilog

Vous trouverez ici les éléments de syntaxe du langage SystemVerilog utiles au module ELECINF102.

L'outil de synthèse Quartus : Tutoriel

Les exercices pratiques réalisés utilisent un outil de synthèse professionnel de la société Altera. Vous trouverez ici un résumé succinct de son utilisation.

Exercices corrigés

Vous trouverez ici des propositions de corrections pour différents exercices abordés, que ce soient des exercices "papier" ou du code SystemVerilog.

Annales

  • Vous trouverez sur cette page les annales des dernières années.

Vous trouverez ici des annales (sans corrigés) d'exercices "théoriques" proposés en contrôle de connaissance dans d'anciennes versions du module.

Bibliographie

  1. Le polycopié du module contenant le détail des leçons.
  2. L'ancien polycopié du module comporte des leçons détaillées sur la logique combinatoire et synchrone (chapitres 1 à 6) . Son contenu n'est pas tout à fait en phase avec le programme du module mais est un bon complément.

 

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